рефераты конспекты курсовые дипломные лекции шпоры

Реферат Курсовая Конспект

Синхронный -триггер с динамическим управлением записью

Синхронный -триггер с динамическим управлением записью - раздел Высокие технологии, Стандартные серии цифровых интегральных микросхем Среди Триггеров С Динамическим Управлением Широкое Распространение Получила Т...

Среди триггеров с динамическим управлением широкое распространение получила так называемая трех триггерная схема. Схема строится на основе синхронного RS-триггера (элементы 2, 3, 5, 6) со статическим управлением записью. Она реагирует на входные сигналы

 

в течение всей длительности сигнала С=1. Чтобы она реагировала на входной сигнал только при переходе С из 0 в 1, необходимо запомнить сигнал, существовавший на входах S, R до прихода С=1. Для этого добавляют элементы 1, 4 и строят RS-триггеры на элементах 1, 2 и 3, 4. Так и получается трех триггерная схема.

При С=0 триггер находится в режиме хранения статического состояния. Входные информационные сигналы не воздействует на выходной триггер 5,6, поскольку на выходах элементов 2, 3 логическая единица независимо от величин входных сигналов. Элементы 1 и 4 при С=0 фактически выполняют функцию инверторов. Если и , то на выходах элементов 1 и 4 нули, если хотя бы один из входов или равен нулю, то на выходе соответствующего элемента 1 или 4 логическая единица.

Если один из сигналов или равен нулю, то при переходе синхронизирующего сигнала из «0» в «1» (С=0ä1) на входе одного из элементов 2 или 3 произойдет совпадение единиц, которое сформирует на его выходе нулевой сигнал. Этот сигнал установит выходной триггер на элементах 5, 6 в соответствующее состояние, кроме того, зафиксирует единицу на выходе того из элементов 1 или 4, который сформировал сигнал установки. В дальнейшем схема становится нечувствительной к изменению сигнала со стороны этого входа ( или ). Однако, остается возможность влияния со стороны второго информационного входа пока С=1, то есть триггер 5, 6 может получить сразу два нулевых сигнала, что противоречило бы логике его функционирования. Чтобы исключить возможность такого влияния, дополнительно вводят связи, отмеченные пунктирными линиями.

В результате получается окончательная схема, в которой сигнал с выходов элементов 2, 3 одновременно выполняет три функции:

 

· установка выходного триггера;

· запоминание сигнала установки выходного триггера, сформированного в момент перехода синхронизирующего сигнала из «0» в «1»;

· блокировка возможности влияния на выходной триггер со стороны второго информационного входа.

 

Примечание: если до прихода единичного значения тактового сигнала (С=1) на информационных входах одновременно = =0, то произойдет ошибочное срабатывание. Устранить этот недостаток можно за счет некоторого усложнения схемы, можно также считать недопустимой комбинацию < >=00. На практике полученный вариант схемы чаще применяется при построении D и T – триггеров, в которых указанная комбинация сигналов уже просто не встречается.

 

– Конец работы –

Эта тема принадлежит разделу:

Стандартные серии цифровых интегральных микросхем

Комплексная цель первого модуля.. Познакомиться с основными понятиями в области схемотехнического.. Основные типы выходных каскадов цифровых интегральных микросхем..

Если Вам нужно дополнительный материал на эту тему, или Вы не нашли то, что искали, рекомендуем воспользоваться поиском по нашей базе работ: Синхронный -триггер с динамическим управлением записью

Что будем делать с полученным материалом:

Если этот материал оказался полезным ля Вас, Вы можете сохранить его на свою страничку в социальных сетях:

Все темы данного раздела:

Стандартные серии цифровых интегральных микросхем.
Выпускаемые интегральные микросхемы в зависимости от технологии изготовления и их разновидностей подразделяются на серии, отличающиеся статическими и динамическими параметрами, функциональным разно

Выходной каскад с открытым коллектором.
    На схеме в качестве примера условно показан выходной каскад на транзисторе VT с диодом Шоттки. (Транзистор с диодом Шоттки, обеспечивает более высокую скорость рассе

Некоторые интегральные микросхемы логических элементов.
  Ориентируясь на серию КР 1553 – аналог серии SN 74ALS, рассмотрим некоторые из наиболее часто используемых интегральных микросхем логических элементов. Приведем примеры условных гра

Система маркировки интегральных микросхем.
Маркировка интегральных микросхем – это символическое обозначение, наносимое на корпус. Оно несет в себе информацию о назначении микросхемы и некоторых ее свойствах (параметрах), например, конструк

Основные параметры цифровых логических микросхем.
Различают электрические (статические, динамические), схемотехнические, конструктивные, интегральные и другие параметры цифровых интегральных микросхем. К основным статическим

Триггеры.
  Триггером называется цифровое устройство, которое может находиться в одном из двух устойчивых состояний. Состояние триггера определяется уровнем напряжения на его выходах. Если напр

Асинхронный RS-триггер
Функциональная схема и УГО RS триггера имеют вид:     Триггер функционирует в соответствии со следующей таблицей переходов:   Таблица пер

Асинхронный - триггер.
Данный тип триггера в отличие от предыдущего реализуется на элементах И-НЕ. Ниже приведена его функциональная схема, УГО, таблица переходов и пример временной диаграммы работы.  

Синхронный одноступенчатый RS – триггер со статическим управлением записью
Функциональная схема, УГО, таблица переходов и пример временной диаграммы работы одноступенчатого синхронного RS – триггера со статическим управлением записью приведены ниже.  

D-триггер со статическим управлением записью
  Этот тип триггера строится на основе синхронных одноступенчатых и двухступенчатых RS-триггеров Функциональная схема и УГО триггера имеют следующий вид:   &nbs

JK – триггер со статическим управлением записью
  Таблица переходов JK – триггера со статическим управлением по ходу «С» может быть представлена следующим образом:   Таблица переходов JK – триггера

Асинхронный и синхронный Т-триггеры
  Триггер со счетным входом (иначе Т-триггер) каждый раз с приходом очередного счетного импульса перебрасывается в противоположное состояние. Асинхронный Т- триггер может быть реализо

Триггеры с динамическим управлением записью
Триггеры с динамическим управлением записью отличаются тем, что изменение выходного состояния происходит в течение короткого времени в момент прохождения переднего или заднего фронтов сигнала на си

D-триггер с динамическим управлением записью
Требуемую структуру D-триггера можно получить на основе RS-триггера с динамическим управлением записью:       Роль входа D выполняет вход R исходн

JK-триггер с динамическим управлением записью
В интегральном исполнении выпускаются JK-триггеры, срабатывающие как по переднему так и по заднему фронту синхронизирующего сигнала «С». В основе JK-триггера, срабатывающего по переднему фронту, мо

Последовательные (сдвигающие) регистры
Последовательные регистры выполняют сдвиг информации, хранившейся в i разряде, в (i+1) разряд (сдвиг вправо) или в (i-1) разряд (сдвиг влево). Для построения могут использоваться только триггеры с

Параллельно-последовательные и последовательно-параллельные регистры
  Параллельно-последовательные и последовательно-параллельные регистры могут быть построены на триггерах с динамическим управлением записью или двухступенчатых синхронных триггерах со

Двоичные дешифраторы.
  Двоичный дешифратор – это комбинационная схема, преобразующая двоичный код на адресных входах в сигнал на одном из выходов. Десятичный номер этого выхода соответствует двоичному код

Мультиплексоры
Мультиплексор – это многовходовая комбинационная схема с одним выходом. Входы мультиплексора подразделяются на информационные D0D1…Dn-1 и управляющие V

Демультиплексоры.
  Демультиплексор – это комбинационная схема, выполняющая функцию, обратную функции мультиплексора, то есть она имеет один информационный, k управляющих входов и n информационных выхо

Шифраторы
Шифратор – это комбинационная схема, преобразующая унитарный код на входе в один из позиционных кодов на выходе. Если позиционный код на выходе двоичный, то шифратор называется двоичным. Одно из ос

Полный одноразрядный комбинационный сумматор.
Схема полного комбинационного сумматора складывает i-ые разряды слагаемых ai и bi и перенос из предыдущего разряда Pi-1. Для ее реализации потребуется дв

Накапливающие двоичные сумматоры
Схемы накапливающих двоичных сумматоров строятся на основе комбинационных сумматоров с добавлением регистров для запоминания суммы. Схема последовательного накапливающего сумматора имеет вид:

Схемы сравнения.
Схемой сравнения называют комбинационную схему, реализующую следующие системы уравнений: 0, А ¹ В 0, А £ В 0, А ³ В А=В = А>В = А<В = 1, А = В 1, А

Схемы контроля четности
Схемы контроля четности используются для контроля приема/передачи информации для формирования контрольного разряда или проверки контрольной суммы. В случаях контроля на четность или нечетн

Счётчики
  Счётчик – это операционный узел ЭВМ, который подсчитывает количество входных импульсов и запоминает код, соответствующий этому количеству. Если запоминаемый код – двоичный, то счётч

Асинхронные двоичные счётчики с последовательным переносом.
  Асинхронные двоичные счётчики с последовательным переносом строятся на основе цепочки последовательно включённых Т-триггеров, каждый из которых делит входную последовательность на д

Асинхронные двоичные счётчики со сквозным и параллельным переносами.
  Для ускорения срабатывания схем асинхронных счётчиков необходимо чтобы триггеры счетчика меняли своё состояние не последовательно во времени, а непосредственно вслед за приходом оче

Реверсивные двоичные счетчики
  Реверсивные двоичные счетчики могут считать в прямом или обратном направлениях в зависимости от управляющих сигналов или зависимости от того, на какой вход подаются счетные импульсы

Определение требуемого числа триггеров n, выбор типа триггера, построение базовой схемы двоичного счетчика для M=2n.
В нашем случае n=]log26[=3, M=8. Выбор типа триггера и базовой схемы зависят от целей построения счетчика. В рассматриваемом примере будем считать, что базовая схема представляе

Некоторые интегральные микросхемы двоичных счетчиков
    В этой микросхеме как бы два счетчика в одном корпусе с общими входами R. Для первого счетчика M1=2, для второго М2=8.

Хотите получать на электронную почту самые свежие новости?
Education Insider Sample
Подпишитесь на Нашу рассылку
Наша политика приватности обеспечивает 100% безопасность и анонимность Ваших E-Mail
Реклама
Соответствующий теме материал
  • Похожее
  • Популярное
  • Облако тегов
  • Здесь
  • Временно
  • Пусто
Теги