Организация динамической памяти - раздел Компьютеры, Организация ЭВМ и систем Структура Микросхем Динамической Памяти (Dram) В Целом Близка К Структ...
Структура микросхем динамической памяти (DRAM) в целом близка к структуре микросхем статической памяти. Однако для уменьшения количества выводов в микросхемах динамической памяти используется мультиплексированные входы адреса. Адрес, подаваемый с шины адреса процессора, делится на две части - адрес строки и адрес столбца. При адресации ячеек DRAM эти части адреса, последовательно во времени, подаются на адресные входы микросхемы памяти в сопровождении соответственно стробов адреса строки RAS (Row Address Strobe) и столбца CAS (Column Address Strobe). Сначала подаются адресные биты, выбирающие строку массива ячеек. По сигналу RAS эти биты сохраняются в защелке адреса строки внутри микросхемы, после чего на те же выводы микросхемы подаются младшие адресные биты.
Разделение полного адреса, выдаваемого процессором, и последовательную выдачу его на микросхему памяти осуществляет мультиплексор, входящий в схему управления (контроллер) динамической памятью.
Временные диаграммы ввода адреса запоминающего элемента в микросхемы DRAM приведены на рисунке 3.5.1.
Рисунок 3.5.1- Временные диаграммы сигналов ввода адреса в микросхему DRAM
Структура асинхронной динамической памяти DRAM конфигурации 2М х 8 емкостью 16 Mбит показана на рисунке 3.5.2. Ее ячейки организованы в массив 4 К х 4 К, в котором 4096 запоминающих элементов каждой строки разделены на 512 групп
Рисунок 3.5.2- Организация микросхемы динамической памяти 2М х 8
по 8 бит, так что в каждой строка хранит 512 байт данных. Для адресации 4096 строк необходимо 12 адресных разрядов. Еще 9 разрядов адреса необходимы для выбора из строки группы из 8 бит, поэтому для доступа к каждому байту в микросхеме с рассматриваемой организацией необходим 21-разрядный адрес. Старшие 12 и младшие 9 разрядов адреса образуют адреса строки и столбца байта.
В процессе операции чтения или записи сначала на адресные выводы микросхемы подается адрес строки. При активизации сигнала RAS он загружается в защелку (регистр) адреса строки микросхемы. Адрес строки дешифрируется дешифратором адреса строки, который активизирует одну из линий выбора строки запоминающего массива 0,1…4095. Содержимое выбранной строки массива с помощью схемы записи- чтения считывается в регистр- защелку 512x8 статического типа.
Через некоторое время после загрузки адреса строки на адресные выводы микросхемы подается адрес столбца, который загружается в защелку адреса столбца при активизации строба CAS. 9 линий этого регистра выбирают адресованный байт из 512, считанных в защелку 512x8 бит. Если управляющий сигнал R/W# указывает на операцию чтения, выбранный байт выставляется на лини данных D7…D0.
Для осуществления записи в микросхему, информация с линий D7…D0 пересылается в соответствующую группу из 8-ми бит защелки 512x8 и замещает их прежнее содержимое. В микросхемах динамической памяти, как правило, активным сигналам RAS и CAS соответствует низкий уровень напряжения, поэтому стробирование адреса выполняется при переходе соответствующего сигнала от высокого уровня к низкому. На схемах эти сигналы обозначаются как RAS и CAS.
Особенностью запоминающих элементов динамической памяти является то, что при считывании информации из них их содержимое разрушается, в связи с чем, после окончания действий по записи или чтению информации в защелку 512x8, необходимо регенерировать содержимое считанной в эту защелку строки массива. Для этого ранее сохраненное в защелке содержимое строки (при чтении информации из микросхемы), или с частью модифицированных бит (при записи информации в микросхему) записывается в считанную строку.
Необходимость восстановления содержимого выбранной строки запоминающего массива является причиной еще одного недостатка микросхем DRAM- обязательного ожидания окончания процесса перезаписи информации из защелки в выбранную строку перед операцией записи- чтения данных из другой строки. Это приводит к увеличению времени чтения- записи микросхемы. Однако, если последующий адрес записи- чтения относится к той же строке микросхемы, то адресуемый байт можно считать прямо из защелки, без повторной подачи адреса строки, с подачей на микросхему только адреса столбца в сопровождении строба CAS. Описанный режим записи - чтения информации из смежных ячеек памяти одной строки называется режимом быстрого страничного чтения (Fast Page Mode- FPM). Он обеспечивает значительное снижение времени записи- чтения в режиме пакетного обмена.
В связи с вышеописанной организацией микросхем динамической памяти подача адреса строки в ходе операции считывания или записи приводит к обновлению содержимого всех ячеек выбранной строки. Поэтому, для того, чтобы поддерживать содержимое памяти DRAM, достаточно периодически обращаться к каждой ее строке. Обычно эти действия выполняется с помощью специальной схемы, называемой схемой регенерации (Memory Refresh- “освежение” памяти), являющейся обязательным компонентом архитектуры ЭВМ, использующей динамическую память. Заметим однако, что основные действия по регенерации микросхем DRAM осуществляются внутри самих микросхем. Подсистема регенерации должна осуществлять только отсчет интервала регенерации и формировать адреса регенерируемых строк.
Благодаря своей высокой емкости (от 1 до 256 Мбит) и дешевизне, микросхемы DRAM широко использовались в запоминающих устройствах ЭВМ. Микросхемы имели различную организацию, благодаря чему из них можно было легко компоновать модули память требуемой емкости и разрядности. Конструктивно они выполнялись в виде модулей SIMM-30 и SIMM-72. Первые из них имели разрядность в 8 бит и емкость до 4 Мбайт. Разрядность модулей SIMM-72 составляла 32 бита, а емкость находилась в пределах от 1-го до 32 Мбайт.
Содержание... ОБЩИЕ СВЕДЕНИЯ О ЭВМ Этапы развития ЭВМ Характеристики ЭВМ...
Если Вам нужно дополнительный материал на эту тему, или Вы не нашли то, что искали, рекомендуем воспользоваться поиском по нашей базе работ:
Организация динамической памяти
Что будем делать с полученным материалом:
Если этот материал оказался полезным ля Вас, Вы можете сохранить его на свою страничку в социальных сетях:
Этапы развития ЭВМ
Идея использования программного управления для построения устройств, автоматически выполняющих арифметические вычисления, была впервые высказана английским математиком Ч. Бэббиджем в 1833 г. Одн
Характеристики ЭВМ
Важнейшими характеристиками ЭВМ являются быстродействие и производительность. Эти характеристики тесно связаны. Быстродействие характеризуется числом команд, выполняемых ЭВМ за одну секунду. Быстро
Обобщенная структура ЭВМ
Обобщенная структура ЭВМ приведена на рисунке 1.4.1. В состав ЭВМ входят: запоминающие устройства (ЗУ), процессор, устройства ввода и вывода (УВВ).
Процессор предназначен д
Структура ЭВМ на основе общей шины
При организации ЭВМ на основе общей шины (ОШ) взаимодействие между ее устройствами осуществляется через общую шину, к которой подключены все устройства, входящие в состав ЭВМ.
Структура ЭВМ на основе множества шин
По такому принципу построены современные компьютеры. На рисунке 1.4.3.1 показана 2-х шинная структура ЭВМ, в которой выделена одна шина для памяти, а вторая шина используется для подключения устрой
Принцип программного управления
Принцип программного управления заключается в том, что алгоритм вычислений (например, вычисление некоторого выражения) представляется в виде упорядоченной последовательности команд, преобразующих и
Принцип хранимой в памяти программы
Принцип хранимой в памяти программы был предложен Дж. фон Нейманом в 1945 году. Этот принцип стал основой современных машин. В соответствии с этим принципом команды хранятся в памяти, также как и д
Обобщенный формат команд
Команды в ЦВМ могут быть одноадресными, двухадресными и трехадресными (в машинах с так называемой естественной адресацией команд).
Формат одноадресной команды следующий:
Косвенная адресация
При косвенной адресации в адресной части команды указывается адрес
ячейки памяти, в которой находится адрес операнда (косвенная адресация - это адресация адреса). Косвенный
Непосредственная адресация
В поле адреса команды находится не адрес, а сам операнд. В отличие от других типов адресации, при выполнении команд с непосредственной адресацией отсутствует дополнительный цикл обращения в память
Относительная (базовая) адресация
Адрес операнда определяется как сумма содержимого адресного поля команды и некоторого числа, называемого базовым адресом. Базовый адрес является косвенным. Для указания его адреса в команде предусм
Индексная (автоинкрементная или автодекрементная) адресация
При обработке больших массивов данных, выбираемых последовательно друг за другом, нет смысла каждый раз обращаться в память за новым адресом.Для этого достаточно автоматически менять содержимое спе
ОЗУ с произвольным доступом
В оперативных ЗУ с произвольным доступом (Random Access Memory - RAM) запись или чтение осуществляется по адресу, указанному регистром адреса (РА). Информация, необходимая дл
Особенности микросхем синхронной динамической памяти
Описанная динамическая память управляется в асинхронном режиме. Она тактируется только управляющими сигналами RAS и CAS и момент готовности микросхемы к обмену информацией с процессо
Основные характеристики ЗУ
1. Емкость памяти. Является важнейшей характеристикой ЗУ любого типа. Она определяет максимальное количество информации, которое может в ней храниться. Емкость может измеряться в битах, байтах или
ОЗУ магазинного типа (стековая память)
Cтековая память широко используется в ЭВМ для запоминания содержимого регистров процессора (контекста прерываемой программы), при обработке запросов на прерывания и вызове подпрогра
Ассоциативные ЗУ
Всовременных вычислительных системах широкоиспользуются операция поиска информации. При использовании обычной памяти с адресным принципом доступа к данным эта операция занимает много времени, поско
Декомпозиция процессора на УА и ОУ
Основу процессора составляют устройство управления (УУ) и арифметическое устройство (арифметико-логическое устройство- АЛУ) (см. рисунок 4.2). Устройство управления реализует функции управления ход
АЛУ для сложения и вычитания чисел с фиксированной запятой
Операция сложения в АЛУ обычно сводится к арифметическому сложению кодов чисел путём применения инверсных кодов - дополнительного или обратного для представления отрицательных чисел. Обратный код и
Методы ускорения умножения
Методы ускорения умножения делятся на аппаратурные и логические. Как те, так и другие требуют дополнительных затрат оборудования. При использовании аппаратурных методов дополнительные затраты обору
Особенности операций десятичной арифметики
Арифметические операции над десятичными числами (сложение, вычитание, умножение, деление) выполняются аналогично операциям над целыми двоичными числами. Основой АЛУ десятичной арифметики является
Аппаратные УУ
Управляющие устройства с жесткой логикой представляют собой логические схемы, вырабатывающие распределенные во времени управляющие сигналы. В отличие от управляющих устройств с хранимой в памяти ло
Микропрограммные УУ
Альтернативой аппаратного способа реализации УУ является микропрограммное управление, согласно которому сигналы генерируются программой, подобной программе, написанной на машинном языке для ЭВМ. Э
Рабочий цикл процессора
Функционирование процессора состоит из повторяющихся рабочих циклов, каждый из которых соответствует выполнению либо целой команды, либо её части. Завершив рабочий цикл процессор переходит к выполн
Понятие о слове состояния процессора
В ходе функционирования процессора постоянно меняется состояние его внутренних регистров. Сигнал “Запрос на прерывание”, а также команда “Вызов подпрограммы” приводят к прекращению выполнения основ
Процедура выполнения команд перехода (условного и безусловного)
При естественной адресации адрес следующей команды получается из адреса выполняемой команды увеличением его на шаг адресации (1, 2, 4 и т.д. в зависимости от количества байт в команде). Производитс
Хотите получать на электронную почту самые свежие новости?
Подпишитесь на Нашу рассылку
Наша политика приватности обеспечивает 100% безопасность и анонимность Ваших E-Mail
Новости и инфо для студентов